Programme vhdl
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anjely
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anjely Messages postés 3 Date d'inscription mercredi 23 janvier 2008 Statut Membre Dernière intervention 1 août 2008 - 1 août 2008 à 11:24
anjely Messages postés 3 Date d'inscription mercredi 23 janvier 2008 Statut Membre Dernière intervention 1 août 2008 - 1 août 2008 à 11:24
A voir également:
- Forum vhdl
- "/Forum/ref.php?url=" ✓ - Forum PHP
- Gambas forum - Forum Visual Basic
- Symfony - Forum PHP
- Codeigniter ✓ - Forum PHP
- "/Forum/redirector.php?url=" - Forum PHP
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NHenry
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vendredi 14 mars 2003
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4 septembre 2024
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31 juil. 2008 à 11:52
31 juil. 2008 à 11:52
Bonjour,
[infomsg.aspx Thèmes] / [infomsgf_VB-NET-VB-2005_40.aspx VB.NET et VB 2005] / [infomsgt_DIVERS_221.aspx Divers] / [infomsgt_DEBUTANTS_227.aspx Débutants] / programme vhdl -> VHDL ????
Euh, ce serait mieux dans le bar ...
Sinon, connaissant un peu ce langage, je pense que c'est faisable, mais ce serait trop facile, mais allez juste pour le fun, une piste :
Un compteur 0-9 et à 0, tu met à 1 (à condition d'avoir une fréquence 10* celle que tu veux sortir).
http://nhen0039.chez-alice.fr/index.php
[infomsg.aspx Thèmes] / [infomsgf_VB-NET-VB-2005_40.aspx VB.NET et VB 2005] / [infomsgt_DIVERS_221.aspx Divers] / [infomsgt_DEBUTANTS_227.aspx Débutants] / programme vhdl -> VHDL ????
Euh, ce serait mieux dans le bar ...
Sinon, connaissant un peu ce langage, je pense que c'est faisable, mais ce serait trop facile, mais allez juste pour le fun, une piste :
Un compteur 0-9 et à 0, tu met à 1 (à condition d'avoir une fréquence 10* celle que tu veux sortir).
http://nhen0039.chez-alice.fr/index.php
anjely
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1 août 2008
31 juil. 2008 à 14:40
31 juil. 2008 à 14:40
merci Henry! je l'ai déjà fait comme ceci, mais je ne sais pas si ça va marcher
entity pwm is
Port ( i_clock : in STD_LOGIC;
i_reset : in STD_LOGIC;
i_Ce : in std_logic;
out_pwm: out std_logic);
end pwm;
architecture Behavioral of pwm is
---declaration des signaux---
--signal pour pwm--
signal sig_pwm_out: std_logic;
signal sig_pwm: std_logic_vector(3 downto 0);
begin
----------------------------------------------
pwm:process(i_clock, i_reset)
begin
if i_reset='1' then
sig_pwm <= (others=>'0');
elsif (i_clock'event and i_clock = '1') then
if i_Ce_1k='1' then
if sig_pwm = 10 then --voir 9
sig_pwm<= (others=>'0');
sig_pwm_out<='1';
else
if sig_pwm=1 then
sig_pwm_out<='0';
end if;
sig_pwm<=sig_pwm+1;
end if;
end if;
end if;
end process;
out_pwm<=sig_pwm_out;
entity pwm is
Port ( i_clock : in STD_LOGIC;
i_reset : in STD_LOGIC;
i_Ce : in std_logic;
out_pwm: out std_logic);
end pwm;
architecture Behavioral of pwm is
---declaration des signaux---
--signal pour pwm--
signal sig_pwm_out: std_logic;
signal sig_pwm: std_logic_vector(3 downto 0);
begin
----------------------------------------------
pwm:process(i_clock, i_reset)
begin
if i_reset='1' then
sig_pwm <= (others=>'0');
elsif (i_clock'event and i_clock = '1') then
if i_Ce_1k='1' then
if sig_pwm = 10 then --voir 9
sig_pwm<= (others=>'0');
sig_pwm_out<='1';
else
if sig_pwm=1 then
sig_pwm_out<='0';
end if;
sig_pwm<=sig_pwm+1;
end if;
end if;
end if;
end process;
out_pwm<=sig_pwm_out;
anjely
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1 août 2008
1 août 2008 à 11:24
1 août 2008 à 11:24
Bonjour à vous!
j'ai réussi à faire mon programme, merci.
j'ai réussi à faire mon programme, merci.
